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Package and pin listings
HDLC/TDM/GPIO
HDLC1_TXCLK[CLK16]/GPIO_0/QE_BRG_5/TD
AA20
IO
OV DD
-
M1_TCK[CLK4]
HDLC1_RXCLK[CLK15]/GPIO_1/TDM1_RCK
AA21
IO
OV DD
-
[CLK3]
HDLC1_TXD/GPIO_2/TDM1_TD/CFG_RESET_
AB22
IO
OV DD
1
SOURCE[0]
HDLC1_RXD/GPIO_3/TDM1_RD
HDLC1_CD_B/GPIO_4/TDM1_TFS
HDLC1_CTS_B/GPIO_5/TDM1_RFS
HDLC1_RTS_B/GPIO_6/TDM1_STROBE_B/CF
AB23
W19
V19
AA23
IO
IO
IO
IO
OV DD
OV DD
OV DD
OV DD
-
-
-
-
G_RESET_SOURCE[1]
HDLC2_TXCLK[CLK14]/GPIO_16/QE_BRG_7/T
Y20
IO
OV DD
-
DM2_TCK[CLK6]
HDLC2_RXCLK[CLK13]/GPIO_17/TDM2_RCK
Y22
IO
OV DD
-
[CLK5]/QE_BRG_8
HDLC2_TXD/GPIO_18/TDM2_TD/CFG_RESET
W20
IO
OV DD
1
_SOURCE[2]
HDLC2_RXD/GPIO_19/TDM2_RD
HDLC2_CD_B/GPIO_20/TDM2_TFS
HDLC2_CTS_B/GPIO_21/TDM2_RFS
HDLC2_RTS_B/GPIO_22/TDM2_STROBE_B/CF
W21
V20
Y23
U20
IO
IO
IO
IO
OV DD
OV DD
OV DD
OV DD
-
-
-
-
G_RESET_SOURCE[3]
Power
AVDD1
AVDD2
AVDD3
GVDD
L16
M16
N8
F6, G6, H6, J6, K6, L6,
-
-
-
-
-
-
-
-
-
-
-
-
N6, P6, R6, T6, U6, V6,
V7
NVDD
F7, F8, F9, F10, F11,
-
-
-
F12, F13,F14, F15, F16,
F17, F18, G18,H18, J18,
L18, M18, N18, P18,R18,
T18, U18, V8, V9, V10,
V11, V12, V13, V14, V15,
V16, V17, V18
MPC8309 PowerQUICC II Pro Integrated Communications Processor Family Hardware Specifications, Rev. 3
Freescale Semiconductor
63
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